Результат поиска: найдено 66 объектов.

Совпадение
Ограничение области поиска
1. Симуляция usbhost контроллера
(FPGA & Verilog блог)
... x=idx+1; cmd_time[idx]=203219; cmd_val[idx]=8'h25; idx=idx+1; cmd_time[idx]=203222; cmd_val[idx]=8'h05; idx=idx+1; idx=0; end reg [32:0]counter=0; always @(posedge clock) begin counteriverilog -o ...
Создано 18 марта 2020
2. Реверс инжиниринг микросхемы RGB светодиода WS2812B
(Проекты Altera Quartus II для платы Марсоход)
s7GkTgyDVCc Приближается Новый Год! Мы поздравляем читателей нашего сайта с этим праздником! НО, сегодня нам нужен Новогодний FPGA Проект. У нас уже чего только не было на сайте: и двигалось и светило ...
Создано 31 декабря 2019
3. Verilator
(FPGA & Verilog блог)
... с помощью Verilator. Для примера возьмем вот такой простой файл счетчика с асинхронным сбросом, написанный на Verilog HDL (файл counter.v): module counter(   input wire rst,   input wire clk,   ...
Создано 26 ноября 2019
4. Создание нового FPGA проекта Intel Quartus Prime с нуля
(Intel Quartus Prime)
... платы Маросход3. Текст модуля: module project(   input wire clk,   output wire [7:0]led ); reg [31:0]counter; always @(posedge clk)   counter Assignments Editor. Тут не обойтись без документации ...
Создано 03 ноября 2019
5. Подборка проектов для платы Марсоход2bis
(Проекты для платы Марсоход2bis)
... ниже проектов можно получить на нашей странице github: https://github.com/marsohod4you/marsohod2bis Внутри этого репозитория для каждого отдельного FPGA проекта создана отдельная папка, например, counter_verilog ...
Создано 26 августа 2019
6. Управление светодиодной лентой
(Проекты Intel Quartus Prime для платы Марсоход3)
... = 2; localparam NUM_TOTAL = (NUM_LEDS+NUM_RESET_LEDS); //3 tick counter reg [1:0] cnt3 = 2'b0; always @(posedge clk)   if (cnt3 == 2'b10)     cnt3  ...
Создано 25 декабря 2018
7. Как вернуть скрипту результат симуляции Verilog?
(Разное)
... симулировать счетчик с синхронным сбросом: module counter(    input wire nreset,    input wire clk,    output wire [7:0]out ); reg [7:0]cnt; always @( posedge clk )   if( !nreset)     cnt  ...
Создано 11 сентября 2018
8. Первый проект для платы Марсоход2RPI
(Проекты Intel Quartus Prime для Марсоход2RPI)
... на плате кнопки KEY[0] счетчик будет сбрасываться, а по нажатию кнопки KEY[1] будет останавливаться счет. reg [31:0]counter; always @( posedge w_clk ) begin   if( KEY[0]==1'b0 )     counter Seria ...
Создано 26 ноября 2017
9. Запуск тестовых программ в SoC MIPSfpga на плате Марсоход3
(MIPSfpga в плате Марсоход3)
...  Итак, в проекте mipsfpga_plus есть папка programs и в ней еще несколько подпапок: 00_counter 01_light_sensor 02_cache_misses 03_pipeline_bypasses 04_memtest 05_uart 06_timer_irq 07_eic 08_uart_irq ...
Создано 18 ноября 2017
10. Компилируем и испытываем процессор MIPSfpga в плате Марсоход3
(MIPSfpga в плате Марсоход3)
... лучилось. 7) После пункта 6 процессор уже готов к работе, но нужно туда загрузить ему программу. Примеры программ есть в папке mipsfpga-plus\programs\. Самый простой пример - это mipsfpga-plus\programs\00_co ...
Создано 10 ноября 2017
11. Виртуальные светодиоды и 7-ми сегментный индикатор
(Проекты Intel Quartus Prime для платы Марсоход3)
... wire w_clk_hdmi; wire w_locked; mypll mypll_inst(   .inclk0( CLK100MHZ ),   .c0( w_clk_video ), //74MHz   .c1( w_clk_hdmi ), //370MHz   .locked( w_locked ) ); reg [47:0]counter; always @( posedge ...
Создано 06 ноября 2017
12. Радиопередатчик с фазовой модуляцией
(Проекты Intel Quartus Prime для платы Марсоход3)
После последнего проекта, где для точного измерения интервалов времени используется динамический сдвиг фазы тактовой частоты PLL в ПЛИС Альтеры, пришла в голову другая идея. А что если попытаться реализовать ...
Создано 04 мая 2017
13. Точное измерение интервалов времени с помощью ПЛИС
(Проекты Intel Quartus Prime для платы Марсоход3)
  Предположим есть задача - измерить время распространения сигнала в линии задержки, как на рисунке выше. Самый простой и очевидный способ измерения требует высокой частоты проекта. Период тактовой ...
Создано 17 апреля 2017
14. Динамический сдвиг фазы частоты с PLL
(Разное)
... и в нем появляются новые входы и выходы, которых раньше не было. Это входы phasecounterselect[2..0] phaseupdown phasestep scanclk и выход phasedone С помощью этих сигналов можно ...
Создано 13 апреля 2017
15. Как симулировать проекты Quartus Prime выполненные в схеме?
(Разное)
... сигнальным линиям. Тактовая частота с PLL подается на 32-х битный счетчик LPM_COUNTER. Это так же альтеровский библиотечный компонент. Некоторые выходы счетчика выведены на светодиоды платы LED[7..0]. ...
Создано 21 января 2017
16. Verilog State Machine Framework
(Проекты Intel Quartus Prime для платы Марсоход3)
Рискну предложить почтенной публике мое новейшее "изобретение": VSMF, Verilog State Machine Framework. Я делаю его для одного из наших внутренних проектов. Пока это не полностью завершенная работа, ...
Создано 24 октября 2015
17. Моргаем светодиодами платы Марсоход3
(Проекты Intel Quartus Prime для платы Марсоход3)
... е выше или ниже. С выхода PLL сигнал идет на счетчик LPM_COUNTER. У самого компонента счетчика много параметров. Правый клик на компоненте и из выпадающего меню выбираем пункт Properties. В окне свойс ...
Создано 12 августа 2015
18. Обновление для простого SDRAM контроллера
(Разное)
... std_logic := '0'; signal sdram_dq_oe : std_logic := '0'; --output enable signal init_cnt : integer := 0; --initialization counter value signal refresh_cnt : integer := 0; --refresh ...
Создано 05 марта 2015
19. Текстовый VGA-модуль на VHDL
(Проекты Altera Quartus II для платы Марсоход2)
... значения, получаемые из памяти, иначе же графическая информация не выводится.  process(pixel_clk) begin   if rising_edge(pixel_clk) then             --counters          if (hcnt = 1687) then                  ...
Создано 17 октября 2014
20. Блог новичка: Hello World
(Разное)
... ет увеличивать его значение на один. Нажатие второй кнопки сбрасывает счётчик. Вот так это выглядит на языке VHDL:   library ieee; use ieee.std_logic_1164.all; use ieee.numeric_std.all; entity coun ...
Создано 01 сентября 2014