Sidebar

Смотрите

  • Главная
  • FPGA блог
  • Форум
  • С чего начать?
  • Проекты
  • Intel Quartus Prime
  • Verilog
  • Скачать
  • Магазин
  • О нас

Тэги

Летающая тарелка Phase-Lock Loop отладка Простая USB функция SL4A Quartus II Появились платы ALARM gray counter ИК интерфейс триггер FPGA защелкаб latch Verilog HDL Описание протокола PS 2 для мыши и клавиатуры конкурс CPLD язык Verilog программатор тестбенч Отладка программ в MIPSfpga Python LFSR частотомер Сколково Serial плата Марсоход Убить MAX Icarus Пошаговая инструкция создаем проект Quartus II WinDbg winrad Quartus Prime троичная логика ПЛИС Altera Quartus II more then moore асинхронный сброс редактор последовательный порт Marsohod2 modelsim Decoder serial port MAX10 усилитель симуляция 7-segment

Комментарии

  • Пошаговая инструкция для Quartus II: Симуляция проекта

    Vivian 24.01.2021 07:23
    Greetings from Los angeles! I'm bored to death at work so I decided to check out your site on my ...

    Подробнее...

     
  • Простой генератор псевдослучайных чисел

    Bennett 24.01.2021 04:36
    “A massive-scale pattern iѕ one of tһe finest drapery treatments yօu can do for а window. Ηere is my ...

    Подробнее...

     
  • Простой генератор псевдослучайных чисел

    Pedro 24.01.2021 00:48
    Sky model escorts are seductive, sophisticated аnd they wilⅼ гeally maҝe your vacation memorable.

    Подробнее...

     
  • Спектр сигнала

    ivermectin sale 23.01.2021 23:14
    ivermectin sale: ivermmectin.co/ (http://ivermmectin.co/)

    Подробнее...

     
  • Пошаговая инструкция для Quartus II: Симуляция проекта

    Marshall 23.01.2021 19:48
    Admiring the time and energy you put into your website and detailed information you present. It's ...

    Подробнее...

На форуме

  • Нет сообщений для показа
МАРСОХОД

Open Source Hardware Project

  • Программатор MBFTDI
    • SVF player
    • Драйвер Quartus II
    • Режим USB-to-COM
    • Режим BitBang
  • Плата Марсоход
    • Проекты
  • Плата Марсоход2
    • Описание платы Марсоход2
    • Описание платы Марсоход2bis
    • Проекты
    • Amber ARM SoCAmber ARM SoC
    • Шилд разъемов
    • Шилд Ethernet
    • Шилд 7-ми сегментного индикатора
  • Марсоход2RPI
    • Проекты
  • Плата Марсоход3
    • Проекты
    • MIPSfpga

Результат поиска: найдено 27 объектов.

Совпадение
Ограничение области поиска
1. Разворот бит в шине на Verilog
(Язык описания аппаратуры Verilog HDL)
Казалось бы простая задача: как развернуть биты в шине так, чтоб младший бит стал старшим, а старший самым младшим? Первое, что приходит на ум: написать вот так: reg [7:0]src; //reverse? wire [0:7]re1; ...
Создано 23 сентября 2018
2. Modelsim под Windows и Verilog VPI
(Разное)
... симулятора icarus verilog нужно делать так: iverilog -o qqq testbench.v vvp -M. -mmypli qqq При использовании симулятора ModelSim-Intel под виндовс так же нужно скомпилировать Сишную библиотеку, но ...
Создано 18 сентября 2018
3. Динамический сдвиг фазы частоты с PLL
(Разное)
У нас на сайте уже была пара статей про PLL. PLL - это, если говорить просто, встроенный в ПЛИС генератор тактовых частот. Он позволяет из одной входной тактовой частоты синтезировать несколько других ...
Создано 13 апреля 2017
4. Как симулировать проекты Quartus Prime выполненные в схеме?
(Разное)
... og файлы в ModelSim. Конечно, для этого нам нужно еще написать testbench. Сделаю самый простой тестбенч, который можно придумать: `timescale 1ns/1ns module tb; reg clk = 1'b0; always   clk = #5 ~c ...
Создано 21 января 2017
5. КИХ фильтр на Verilog
(Разное)
В этой статье я хочу рассказать о своих экспериментах по созданию простого параметрического цифрового КИХ фильтра на Verilog HDL. До сегодняшнего дня я старался избегать тем цифровой обработки сигналов ...
Создано 25 апреля 2016
6. Сложности разработки USB хоста для проекта USBTerm.
(Проект графического терминала USBTerm)
... e w_show_next_dev); #1; write_dev_byte(8'h44,1'b1); Это тот случай, когда нужно прочитать что-то из подключенного USB устройства. Тогда на шине посылается пакет c идентификатором 0x69 (IN), дальше test ...
Создано 23 февраля 2016
7. Фотографирование: пульт дистанционного управления к Canon EOS 650D
(Проекты Altera Quartus II для платы Марсоход)
... передается.  void Canon::shutterNow() {   for(int i=0; iiverilog -o myout canon_rc6.v testbench.v Теперь симуляции: >vvp myout Получаю файлы временных диаграмм *.vcd и смотрю их в GtkWave: >gtkwave ...
Создано 28 сентября 2015
8. Симуляция SDRAM контроллера в ModelSim
(Разное)
...  я буду симулировать систему с рабочей частотой всего 20МГц - только с единственно целью убедиться правильно ли спроектирован контроллер. Весь тестбенч вот: `timescale 1ns / 1ns module testbench ...
Создано 16 ноября 2014
9. Интерфейс Verilog VPI
(Разное)
... проекта. Мой тестбенч пусть будет вот такой простой (файл testbench.v): module testbench(); reg [7:0]v0; reg [7:0]v1; initial begin $display("read from C module:");     $getval("myvar0",v0 ...
Создано 24 января 2014
10. Графический дизайн или текст Verilog/VHDL?
(Разное)
Рискну затронуть такую холиварную тему: сравнение двух методов разработки, графический ввод схемы и текстовое описание проекта на языках HDL Verilog / VHDL. Какой метод лучше? Сразу скажу, что я ...
Создано 30 мая 2013
11. FM радио передатчик из платы Марсоход2
(Проекты Altera Quartus II для платы Марсоход2)
7 мая (25 апреля по старому стилю) 1895 года на заседании Русского физико-химического общества российский физик Александр Степанович Попов выступил с докладом и демонстрацией созданного им первого в мире ...
Создано 06 мая 2013
12. Сумматор с переносом на Verilog HDL
(Язык описания аппаратуры Verilog HDL)
... работы сумматора можно написав простой тестбенч. Подаем на входы сумматора разные числа и смотрим результат: `timescale 1ns / 1ns module testbench; reg [7:0]var_a; reg [7:0]var_b; wire [7:0]r_out; ...
Создано 04 марта 2013
13. Отладка Linux в Amber SoC
(ARM System-on-Chip)
... чуть сложнее testbench. Сейчас мне нужно сделать полную модель системы: процессор, boot-rom, память, последовательный порт. Модель системы – это и есть testbench. От тестбенча hello-world будет отличие ...
Создано 09 декабря 2012
14. Проект-исследование счетчика на DET Flip-Flop
(Проекты Altera Quartus II для платы Марсоход2)
Как известно, все цифровые схемы строятся по общему принципу «машины состояния». Вся схема проекта состоит как-бы из двух частей: регистров, которые хранят текущее состояние системы и комбинационной логики, ...
Создано 17 ноября 2012
15. Симуляция проекта Amber23 для платы Марсоход2. Исполнение программы Hello-World!
(Исходный код)
...  ( uart0_tx ), .led (led) ); // ====================================== // Instantiate Testbench UART // ====================================== tb_uart u_tb ...
Создано 24 сентября 2012
16. Симуляция MAX II UFM в ModelSim
(Разное)
... его, а затем перекомпилируйте altufm_none1.v. 8. Конечно нам для симуляции проекта нужен tesbench. Напишем, что-то совсем простое, вроде вот этого: `timescale 1ns / 1ns; module testbench(); reg ...
Создано 30 июля 2012
17. Реализация SIN и COS на Verilog
(Язык описания аппаратуры Verilog HDL)
... и так далее. По этой причине в этой статье я не буду собственно реализовывать синус на Verilog для синтеза в FPGA / CPLD. Вместо этого, я постараюсь предложить некий Verilog testbench для проверки правильности ...
Создано 22 мая 2012
18. Исходный код тестбенча для мПЛИС (проект ПЛИС внутри ПЛИС)
(Исходный код)
  //testbench for mini_cpld   module test;   //64 bytes array used for cpld image reg [7:0] value[0:63]; integer i,j,a,b,c;   //signals ...
Создано 20 июня 2011
19. ПЛИС внутри ПЛИС
(Проекты Altera Quartus II для платы Марсоход)
Я хочу рассказать о своем новом проекте для платы Марсоход. Я попытался сделать проект своей маленькой ПЛИС, написать этот проект на Verilog  и реально запустить его внутри настоящей ПЛИС. Наверное ...
Создано 19 июня 2011
20. Симуляция проекта Теннис
(Разное)
Иногда приходится иметь дело с аппаратными проектами в которых отдельные события происходят довольно редко. И не то что бы рабочая частота была небольшой - как раз нет, рабочая частота довольно высокая ...
Создано 05 марта 2011
  • В начало
  • Назад
  • 1
  • 2
  • Вперёд
  • В конец

Смотрите

  • Главная
  • FPGA блог
  • Форум
  • С чего начать?
  • Проекты
  • Intel Quartus Prime
  • Verilog
  • Скачать
  • Магазин
  • О нас

Подписка

feed1

Тэги

Введение в Verilog Пятый урок ПЛИС Altera USB host плата Марсоход САПР debug Stream небо FPGA Quartus II CodeBench Cyclone V SignalTap hello-world пульт ДУ Verilog Gotcha Ubuntu Фильтр версия 1 перенос ZX spectrum FTDI micron driver программатор MBFTDI AMBER ARM v2a Spectra-Q Software Defined Radio audacity InnovativeFPGA Music марсоход ModelSim инерциоид Продуваем форсунки Cyclone 10LP FIFO тестбенч верилог contest Часть2 Комбинаторная логика Марсоход2RPI gray counter MAX10 программатор Verilog HDL HC-SR04 Linux

Комментарии

  • Пошаговая инструкция для Quartus II: Симуляция проекта

    Vivian 24.01.2021 07:23
    Greetings from Los angeles! I'm bored to death at work so I decided to check out your site on my ...

    Подробнее...

     
  • Простой генератор псевдослучайных чисел

    Bennett 24.01.2021 04:36
    “A massive-scale pattern iѕ one of tһe finest drapery treatments yօu can do for а window. Ηere is my ...

    Подробнее...

     
  • Простой генератор псевдослучайных чисел

    Pedro 24.01.2021 00:48
    Sky model escorts are seductive, sophisticated аnd they wilⅼ гeally maҝe your vacation memorable.

    Подробнее...

     
  • Спектр сигнала

    ivermectin sale 23.01.2021 23:14
    ivermectin sale: ivermmectin.co/ (http://ivermmectin.co/)

    Подробнее...

     
  • Пошаговая инструкция для Quartus II: Симуляция проекта

    Marshall 23.01.2021 19:48
    Admiring the time and energy you put into your website and detailed information you present. It's ...

    Подробнее...

На форуме

  • Нет сообщений для показа